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2006-May	1.2V 600-uW 단일루프 3차 구조의 Mobile Audio Sigma-Delta Modulator 설계 대한전자공학회, 2006-05-01 박홍준
1997-Feb	10 to 250MHz of Lock Range 0.4um Triple Well CMOS PLL 제 4회 반도체 학술대회, 1997-02-01 박홍준
1995-Feb	12bit CMOS A/D 변환기 칩의 설계, 제작 및 시험 제2회 반도체 학술 대회, 1995-02-01 박홍준
2000-Oct	12비트 125KS/s의 ADC를 내장한 모터 제어용 32비트 마이크로 콘트롤러 ASIC Design Workshop 2000, 2000-10-01 박홍준
1995-Feb	14bit self calibration CMOS A/D 변환기 칩의 설계, 제작 및 시험 제 2회 반도체 학술 대회, 1995-02-01 박홍준
1997-Jun	1Gb/s current mode bi-directional I/O buffer Symposium on VLSI Circuits, page. 121 - 122, 1997-06-12 심재윤; 박홍준
1997-Jun	1Gb/s current mode bidirectional I/O buffer Symposium on VLSI circuits, page. 121 - 122, 1997-06-01 박홍준
2009-Nov	55% Data Rate Increase of SSTL DRAM Interface Channels by Eliminating Crosstalk-Induced Jitter 2008 대한전자공학회 추계학술대회, 2009-11-28 박홍준; 이경호; 정해강; 권혜정
2009-Nov	55% Data Rate Increase of SSTL DRAM Interface Channels by Eliminating Crosstalk-Induced Jitter 대한전자공학회 추계종합학술대회, page. 21 - 22, 2009-11-28 심재윤; 이경호; 정해강; 권혜정; 박홍준
2005-Nov	-60dB THD, 32ohm load, 0.7Vrms 출력의 저전력 CMOS class AB Stereo Audio Amplifier 설계 대한전자공학회 2005 추계학술대회, page. 905 - 908, 2005-11-01 박홍준
2003-Nov	6bit 1.1GS/s CMOS Flash ADC IEEK SOC Design Conference, page. 191 - 194, 2003-11-01 박홍준
2003-Aug	8-GS/s 4-비트 CMOS 타임 인터리브 플래쉬 아날로그/디지털 변환기 한국군사과학기술학회 종합학술대회, page. 405 - 408, 2003-08-01 박홍준
1999-Jun	840 Mb/s CMOS demultiplexed equalizing transceiver for DRAM-to processor communication Symposium on VLSI Circuits, page. 23 - 24, 1999-06-17 심재윤; 박홍준
1999-Jun	840 Mb/s CMOS Demultiplexed Equalizing Transceiver for DRAM-to Processor Communication Symp.On VLSI Circuits Digest of Technical Papers, page. 23 - 24, 1999-06-01 박홍준
2017-Feb	A 0.0047mm2 Highly Synthesizable TDC- and DCO-Less Fractional-N PLL with a Seamless Lock Range of fREF to 1GHz IEEE International Solid-State Circuits Conference, 2017-02-05 조화숙; 성기환; 김병섭; 박홍준; 심재윤
2011-Feb	A 0.1-fref BW 1GHz Fractional-N PLL with FIR-Embedded Phase-Interpolator-Based Noise Filtering IEEE International Solid-State Circuits Conference, page. 94 - 95, 2011-02-21 심재윤; 박홍준; 지동우; 서윤재
2011-Feb	A 0.1-fref BW 1GHz fractional-N PLL with FIR-embedded phase-interpolator-based noise filtering ISSCC 2011, 2011-02-20 박홍준; 심재윤; 지동우; 서윤재
2006-Oct	A 0.12GHz-1.4GHz DLL-based clock generator with a multiplied 4-phase clock using a 0.18um CMOS process International SoC Design Conference, page. 241 - 244, 2006-10-01 박홍준
2014-Jun	A 0.4 V Driving Multi-Touch Capacitive Sensor with the Driving Signal Frequency set to (n+0.5) Times the Inverse of the LCD VCOM Noise Period International Symposium on Circuits and System, 2014-06-01 김병섭; Jae-Seung Lee; Done-Hee Yeo; Sang-Soo Lee; Hae-Jung Kwon; 심재윤; 박홍준
2014-Jun	A 0.4 V Driving Multi-Touch Capacitive Sensor with the Driving Signal Frequency set to (n+0.5) Times the Inverse of the LCD VCOM Noise Period IEEE International Solid-State Circuits Conference, page. 682 - 685, 2014-06-02 심재윤; 이재승; 여동희; 권혜정; 이상수; 김병섭; 박홍준

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